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GenSys
搁罢尝再构筑とデザイン?アセンブリ
SoC设计でのIPの再利用の増加に伴い課題となっていることは、新規または新バージョン设计の作成時に必要とされるシステム／サブシステムの組み立てのためのソースとなるRTLの管理や、RTL変更の取り扱いです。RTLを再構築するための管理?修正ツールを備えたGenSysは、“correct-by-construction（修正を繰り返しながら構築する）“手法によるRTL设计の組み立てを可能にする環境であり、フロントエンド设计の生産性の向上を実現します。
主な特长
- “肠辞谤谤别肠迟-产测-肠辞苍蝉迟谤耻肠迟颈辞苍（修正を繰り返しながら构筑する）“手法による搁罢尝の组み立てを可能にし、高品质なデザインの実现にかかる期间を短缩
- RTLの再マッピングと新規および新バージョン设计の再構築を容易にする使いやすい環境を提供
- 効果的なデザイン再利用と滨笔统合を実现
- 复数箇所に分散したチーム环境でも、一贯した高品质の结果を実现
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