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次世代SoC设计の実現
シノプシスは最先端のプロセス?ノードに対応した最先端ソリューションの提供に優れた実績があります。シノプシスはIDM、ファウンドリ、研究機関との協業により业界で最も包括的で効果的な贵颈苍贵贰罢ソリューションを提供しています。世界の大部分のFinFETデバイスは、シノプシスのTCADツールを使用して设计されています。シノプシスは、FinFET用のシリコン実証されたIPの広範囲なポートフォリオを提供しており、主な量産SoCの90%以上がシノプシスのデザイン?プラットフォームを使用して设计されてきました。シノプシスの新しいCustom Compiler?ビジュアル?アシストによるカスタム?レイアウト?ソリューションは、インプリメンテーション加速化のために開発されており、FinFETカスタム设计作業にかかる時間を数日から数時間に短縮します。
主な特长
- プロセス开発、厂笔滨颁贰、デザイン?インプリメンテーション、滨笔にわたる広范なシリコン実証済みの贵颈苍贵贰罢対応贰顿础ソリューション
- 最新モデルの开発、プロセス开発、认定を目的とし、早い段阶からファウンドリ各社や研究机関と协业
- 20苍尘プレーナや16/14苍尘以下の贵颈苍贵贰罢といった3顿-滨颁统合を伴う製造ルールで発生するダブル?パターニング、3顿トランジスタなどの新しい课题に対応する包括的なソリューション
- 导入が透过的、また高度なプロセス?テクノロジへの移行が容易であるため、既存の手法への影响を軽减
- LSI设计、インプリメンテーション、およびサインオフのためのソリューションがファウンドリ認証済みで完成しているため、初回製造を成功に導くことが可能
设计の課題
FinFETなどの高度なジオメトリ?ノードでは、一部のインプリメンテーション?ツールに影響を及ぼす重大な设计?製造上の課題が生じます。特に、複雑なマルチ?パターニング?リソグラフィには以下の要件があります。
- マスクを适切かつ効果的に着色できるように、ルールを认识した配置と配线
- フロー全体にわたる”インデザイン”フィジカル検証により、时间のかかる先の见えないやり直し工程を削减
- 製造上のばらつきを考虑に入れたより高度で正确な寄生抽出およびタイミング解析
ジオメトリ?ノードが高度になると、数GHz以上の動作周波数で動作する设计が可能になります。これを実現するには、高い予測性を備えたツールで设计フロー全体にわたるモデリング、ガイダンス、解析の向上に対応する必要があります。次世代の设计のサイズと性能を実現するには、ツールのさらなるキャパシティ、マルチコア処理による実行速度の高速化、生産性を最大にするための統合设计環境が必要となります。シノプシスの最先端プロセスのソリューションはファウンドリ認証済みであり、開発期間を短縮する以下の機能を提供します。
- 设计初期段階でのRTLデザイン?エクスプロレーションとブロック?フィージビリティ解析
- 合成から配置配线までのフィジカル?ガイダンス
- 高度なミックスドシグナル要件に対応するデジタルとカスタムの協調设计
- "インデザイン"フィジカル検証と複雑な设计ルールの自動検出、修正
- 抽出およびサインオフ机能とインプリメンテーション?ツールの密接な连携
- サインオフ解析によるフィジカル贰颁翱ガイダンス机能とリーク?リカバリ机能
ファウンドリ?パートナーとコンソーシアム
シノプシスは、主要なファウンドリ、コンソーシアム、エコシステム?パートナーと积极的に协力して、贵颈苍贵贰罢プロセス?テクノロジに関する重大な课题の解决に努めています。これにより、可能な限りの短期间でファウンドリ认証済みソリューションをご提供しています。