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础滨驱动的设计应用
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5G 通过引入载波聚合、大规模天线技术（massive MIMO）以及利用毫米波（mmWave）频谱范围的高级调制和高带宽信道提高吞吐量，推动移动和汽车应用的速度、带宽和数据吞吐量大幅提升。这一现状大幅增加了基带、基础架构和应用处理器技术的复杂程度，形成了对新型创新 IP 的需求，以期解决这一复杂性问题。 Synopsys 的 DesignWare? IP 产物组合提供了可靠的解决方案，从高速模拟前端到先进 FinFET 技术和处理解决方案中采用的久经验证的接口 IP，可满足前沿的 5G 芯片组设计的需求。
处理
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复杂基带处理
经过优化的高效处理器可增加每个周期完成的工作量，从而降低功耗&苍产蝉辫;
- ARC HSxD：CPU + DSP 组合架构和多核控制运行；高效连接硬件加速器
- ASIP Designer：可编程的任务优化型芯核/加速器。功耗极低、尺寸极小、计算吞吐量高
- ARC VPX: 带有ISA优化的大位宽SIMD/VLIW 处理器助力通信算法和机器学习
模拟前端
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高速 AFE
模拟前端以极低的功耗提供千兆赫级信道带宽支持。模块化 5G AFE 支持：
- 不同的 MIMO 排列
- 处理超大的 5G 信道和载波聚合
- 直接射频转换实现 RFIC 简化
- 集成到 SoC 中实现更低功耗和 BOM 成本
- 拥有处理高 QAM 要求的高性能
- 300 多种移动和无线设计
接口 IP
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高性能、可信接口 IP
提供高性能 5G 设计所需的 22-nm 到 7-nm 规格
- MIPI CSI-2、DSI 和 M-PHY 提供高速串行接口，连接应用/图像处理器和摄像头传感器
- LPPDR5/4/4X IP 实现多种能够缩短退出延迟的低功耗状态
- PCI Express 5.0/4.0 IP 为芯片到芯片通信提供高吞吐量
- 多协议 PHY 为 PCIe、CCIX、以太网等接口提供高质量的信号完整性和先进的电源管理功能
集成 SIM 卡
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带有硬件信任根的安全 IP
在可靠的环境中完成安全协议加速：
- tRoot HSM 提供了一块“安全飞地”(Enclave)，用于处理 SoC 的敏感数据和操作
- 安全协议加速器 (SPAcc) 支持加密和身份验证
- 高性能 AES-XTS 用于静止数据加密/解密
